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bus.cpp
20
bus.cpp
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@ -346,12 +346,9 @@ uint16_t bus::read(const uint16_t addr_in, const word_mode_t word_mode, const rm
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}
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}
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/// MMU ///
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/// MMU ///
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if ((a >= ADDR_PDR_SV_START && a < ADDR_PDR_SV_END) ||
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if ((a >= ADDR_PDR_SV_START && a < ADDR_PAR_SV_END) ||
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(a >= ADDR_PAR_SV_START && a < ADDR_PAR_SV_END) ||
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(a >= ADDR_PDR_K_START && a < ADDR_PAR_K_END) ||
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(a >= ADDR_PDR_K_START && a < ADDR_PDR_K_END) ||
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(a >= ADDR_PDR_U_START && a < ADDR_PAR_U_END)) {
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(a >= ADDR_PAR_K_START && a < ADDR_PAR_K_END) ||
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(a >= ADDR_PDR_U_START && a < ADDR_PDR_U_END) ||
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(a >= ADDR_PAR_U_START && a < ADDR_PAR_U_END)) {
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if (word_mode == wm_word)
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if (word_mode == wm_word)
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return mmu_->read_word(a);
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return mmu_->read_word(a);
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@ -749,13 +746,9 @@ write_rc_t bus::write(const uint16_t addr_in, const word_mode_t word_mode, uint1
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}
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}
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/// MMU ///
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/// MMU ///
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// supervisor
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if ((a >= ADDR_PDR_SV_START && a < ADDR_PAR_SV_END) ||
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if ((a >= ADDR_PDR_SV_START && a < ADDR_PDR_SV_END) ||
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(a >= ADDR_PDR_K_START && a < ADDR_PAR_K_END) ||
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(a >= ADDR_PAR_SV_START && a < ADDR_PAR_SV_END) ||
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(a >= ADDR_PDR_U_START && a < ADDR_PAR_U_END)) {
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(a >= ADDR_PDR_K_START && a < ADDR_PDR_K_END) ||
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(a >= ADDR_PAR_K_START && a < ADDR_PAR_K_END) ||
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(a >= ADDR_PDR_U_START && a < ADDR_PDR_U_END) ||
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(a >= ADDR_PAR_U_START && a < ADDR_PAR_U_END)) {
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if (word_mode == wm_word)
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if (word_mode == wm_word)
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mmu_->write_word(a, value);
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mmu_->write_word(a, value);
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else
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else
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@ -763,6 +756,7 @@ write_rc_t bus::write(const uint16_t addr_in, const word_mode_t word_mode, uint1
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return { false };
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return { false };
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}
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}
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///////////
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if (a >= 0177740 && a <= 0177753) { // cache control register and others
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if (a >= 0177740 && a <= 0177753) { // cache control register and others
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// TODO
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// TODO
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